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基于高速低功率倍增器的多速率滤波器结构设计

摘要

在多速率信号处理中，用于数字信号处理系统的研究包括采样速率转换。这种技术用于具有不同输入和输出采样率的系统。插值和抽取在多速率信号处理应用中非常有效和流行。本文提出了一种利用布斯乘法器实现抽取因子为3 (D=3)的高速、高效、低功耗多相抽取滤波器的VLSI结构。通过使用展位乘数乘有符号的数字。对于长度为9 (N=9)的滤波器，估计了各种关键性能指标，如切片数量、最大工作频率、LUT数量、输入输出键、功耗、设置时间、保持时间、源和目的地之间的传播延迟。采用布斯乘法器的多相抽取滤波器降低了功耗，与传统乘法器相比，布斯乘法器的功耗较低。采用进位前向加法器提高了计算速度。结果表明，与传统的BFD乘法器和BFD乘法器相比，该方案具有速度提高、面积减小、功耗略有降低、复杂度低的优点。

vishnupriya, K.Neelima

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