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采用流水线技术的高速IIR陷波滤波器

摘要

过滤器正在使用HDL语言进行设计，以提高其速度。单个块速度的增加导致整个块速度的增加。基于现场可编程门阵列(FPGA)的无限脉冲响应陷波滤波器超高速实现的设计与实现。基本的二阶陷波滤波器结构可在Xilinx Virtex-5 FPGA中实现，最大时钟频率为~80MHz。在这里，我们提出了一种基于FPGA的极高速陷波滤波器的设计，该滤波器有效地工作在最大时钟频率~1200MHz，借助2倍分解方法的散射预视(SLA)流水线，在其基本低速结构上应用适当的重定时和展开。为了推广基于FPGA的特定加速因子设计，提出了一种利用帕斯卡三角计算超高速陷波滤波器前馈段和反馈段乘数系数的新方法。

Suresh Gawande, Sneha Bhujbal

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