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高速多输出128bit进位前瞻加法器使用Domino逻辑

摘要

加法是任何VLSI处理器或数字信号处理的基本操作。本文以进位前视加法器为研究对象，对高速、小面积或小功率加法器的设计进行了研究。本文采用domino逻辑实现了基于HSPICE工具的128位进位前加法器。在加法器电路中，传播延迟是主要的缺点。为了克服这一缺点，可以对多米诺电路进行分析，并与65nm技术进行比较。本文基于256位曼彻斯特进位链(MCC)加法器，对不同CMOS技术进行了比较。

a .巴拉提，k .曼尼坎丹，k .拉贾斯里，p .桑蒂尼

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