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低功率FRACTIONAL-N锁相环频率合成器使用45纳米VLSI技术

文摘

权力已经成为最重要的一个参数等各种通信系统的光学数据链接、无线产品、微处理器和ASIC / SOC设计。本文基于VLSI的低功耗的设计和仿真部分- N为蓝牙应用程序锁相环频率合成器。各种频率合成技术、锁相环(PLL)代表在无线通信行业占主导地位的方法。锁相环,像大多数无线通信技术,是相对较新,仅在过去的十年中已经成熟。这个阶段锁定回路设计使用超大规模集成技术,进而提供了高速的性能在低功率。改善的性能fractional-N锁相回路,回路滤波器和迴路是最重要的因素。回路滤波器带宽限制的速度合成频率之间的转换时间。双模分频器的周期操作介绍了锁相环的相位噪声。消除这种相位噪声,数字迴路使用而产生一个随机整数数字平均等于预期的分数比和推动更高频率的虚假内容。形成集中量子化噪声产生的pdf输出到更高频率由低通滤波器去除。

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