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新型低功耗逻辑门使用的技术

文摘

阈下的电压下降在接下来的纳米技术和有关联的增强的泄漏电流的影响。这导致静态(泄漏)总功耗的电源是一个至关重要的部分在一个超大规模集成电路。两种新颖的电路技术对泄漏电流减少逻辑门提出了这项工作。该电路技术应用于普遍NAND和逻辑门。这些低泄漏盖茨的性能与同期相比CMOS电路泄漏最小化技术应用于这些门。这部小说超低泄漏技术提供最大的泄漏电流减少的产量水平较低。低功率状态保留——技术提供了较低的泄漏功率和门的状态也可以保留在睡眠模式。盖茨提出低泄漏设计和模拟使用节奏为90纳米CMOS工艺设计工具。泄漏功率的新方法发现在睡眠模式更有或没有状态保留比早些时候最著名的技术。该技术的动态功耗。

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