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基于动态部分重构的AES算法性能增强

摘要

本工作介绍了FPGA动态重构的部分重构(Partial Reconfiguration, PR)方法。在microblaze等嵌入式微处理器的控制下，试图解释自重构的概念。在这里，PR可以用于减少面积需求和提高系统的通用性。部分重构支持高端fpga，如Sparten III, Virtex系列。如今，加密算法并不安全，嵌入式加密硬件也很昂贵。因此，可以使用可重构硬件，如FPGA，使其更具成本效益和安全性。本课题采用AES (Advanced Encryption Standard，高级加密标准)算法进行加密实现，以达到密码学安全的目的。介绍了动态部分可重构密钥AES加密算法的硬件实现方法。该实现可以很好地解决数字通信中信息的保密性和便捷性。

snehal Wankhade女士，Rashmi Mahajan教授

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