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不同类型全加法器电路的功率和延迟比较

摘要

本文介绍了设计的速度受晶体管尺寸、寄生电容和关键路径延时的限制。功耗和速度是两个重要但相互冲突的设计方面;因此，一个更好的衡量电路性能的指标是功率延迟积(PDP)。全加法器的驱动能力非常重要，因为全加法器主要用于级联配置，其中一个的输出为另一个提供输入。如果全加法器缺乏驱动能力，则需要额外的缓冲，从而增加了功耗。在这里，我们从更低的功耗，更高的速度和更小的芯片尺寸方面简要描述了全加法器电路的发展。我们从最传统的28晶体管全加法器开始，然后逐渐研究了由8个晶体管组成的全加法器。我们还包括一些最流行的全加法器单元，如静态能量回收全加法器(SERF) [7] [8]， Adder9A, Adder9B，基于GDI的全加法器。

Saradindu Panda, A.Banerjee B.Maji, a.k. mukhopadhyay博士

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